Effiziente Verfahren zur Parallelisierung von EMV-Simulationen für den Entwurfsprozess integrierter Schaltungen [Efficient process in the parallelization of electromagnetic compatibility (EMC) simulations for the design process of the integrated circuit]

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dc.identifier.uri http://dx.doi.org/10.15488/1472
dc.identifier.uri http://www.repo.uni-hannover.de/handle/123456789/1497
dc.contributor.author Barke, M.
dc.contributor.author Preisner, T.
dc.contributor.author Mathis, Wolfgang
dc.date.accessioned 2017-05-10T11:33:53Z
dc.date.available 2017-05-10T11:33:53Z
dc.date.issued 2009
dc.identifier.citation Barke, M.; Preisner, T.; Mathis, W.: Effiziente Verfahren zur Parallelisierung von EMV-Simulationen für den Entwurfsprozess integrierter Schaltungen [Efficient process in the parallelization of electromagnetic compatibility (EMC) simulations for the design process of the integrated circuit]. In: Advances in Radio Science 7 (2009), S. 101-105. DOI: https://doi.org/10.5194/ars-7-101-2009
dc.description.abstract In dieser Arbeit wird mit einer parallelisierten Version des PCG-Verfahrens (preconditioned conjugate gradient method) eine effiziente Technik zur numerischen Lösung großer Gleichungssysteme vorgestellt. Der Anwendungsbereich ist dabei die Simulation numerischer Feldberechnungen (beispielsweise durch die Finite-Elemente-Methode). Es wird ferner auf eine Datenstruktur eingegangen, die für die spezielle Struktur der auftretenden Koeffizientenmatrizen geeignet ist. ger
dc.language.iso ger
dc.publisher Göttingen : Copernicus GmbH
dc.relation.ispartofseries Advances in Radio Science 7 (2009)
dc.rights CC BY 3.0
dc.rights.uri https://creativecommons.org/licenses/by/3.0/
dc.subject Design process eng
dc.subject Efficient process eng
dc.subject Parallelizations eng
dc.subject Electrical engineering eng
dc.subject Electronics engineering eng
dc.subject Electromagnetic compatibility eng
dc.subject.ddc 621,3 | Elektrotechnik, Elektronik ger
dc.title Effiziente Verfahren zur Parallelisierung von EMV-Simulationen für den Entwurfsprozess integrierter Schaltungen [Efficient process in the parallelization of electromagnetic compatibility (EMC) simulations for the design process of the integrated circuit]
dc.type article
dc.type Text
dc.relation.issn 1684-9965
dc.relation.doi https://doi.org/10.5194/ars-7-101-2009
dc.bibliographicCitation.volume 7
dc.bibliographicCitation.firstPage 101
dc.bibliographicCitation.lastPage 105
dc.description.version publishedVersion
tib.accessRights frei zug�nglich


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